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專利

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低複雜度的預編碼方法

電機系  黃穎聰老師

一種適用於多輸入多數出通訊系統之低複雜度的預編碼方法,採用一種矩陣雙對角線化的前處理,並提供了一種使用分治法的觀念來完成幾何平均值分解。前處理將估測的通道矩陣分解為雙對角矩陣,而分治法則包括分割與合併兩個階段。在分割階段是先將所有矩陣斜對角元素先分成兩個相鄰元素一個子群組,進而將每個子群組內的元素轉換成其對應的幾何平均值。在合併階段則是將兩兩相鄰的子群組併成一包含四個元素的較大子群組,並將所有元素轉換成其對應的幾何平均值,直到所有矩陣斜對角元素都被併成單一群組並擁有同樣的幾何平均值。

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可規畫平行循環冗餘檢查電路及攪散器電路

電機系  黃穎聰老師

本發明提供一種可規畫平行循環冗餘檢查電路及攪散器電路,可提高電路的產量,關鍵路徑(criticalpath)仍維持與序列型式電路時一樣,面積及延遲則比現有平行化架構更低。此外,亦透過自行發展的視窗軟體介面,讓使用者以輸入參數的方式自動產生對應最佳化的硬體描述語言檔案。

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植物品種權

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技術移轉

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可程式邏輯閘陣列實現之嵌入式頻譜分析與異常訊號偵測系統

電機系    黃穎聰教授 

本技術能將擷取的訊號波形,經過前處理之後,轉換到頻譜上偵測代測模組功能異常的情況。設計包含前置anti-alias與decimation濾波器以及一實數型的快速傅立葉轉換處理器,並可搭配不同的異常訊號偵測演算法。本技術包括Verilog design的原始程式設計碼、電路合成的user constraint file,可在FPGA元件上實現,並提供一FPGA based的雛型驗證系統。

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