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可程式邏輯閘陣列實現之嵌入式頻譜分析與異常訊號偵測系統
本技術能將擷取的訊號波形,經過前處理之後,轉換到頻譜上偵測代測模組功能異常的情況。設計包含前置anti-alias與decimation濾波器以及一實數型的快速傅立葉轉換處理器,並可搭配不同的異常訊號偵測演算法。本技術包括Verilog design的原始程式設計碼、電路合成的user constraint file,可在FPGA元件上實現,並提供一FPGA based的雛型驗證系統。
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